物理 · 固体物理

概念

固体物理用量子力学解释固体（尤其是晶体）的宏观性质：为什么铜导电、玻璃不导电、硅"半"导电。它是本站 L0 层 硅 · 半导体与器件 的直接理论来源。

三块核心内容：

1. 晶体结构：原子怎么排列
2. 能带论：电子能处在哪些能量状态——这是解释导电性的钥匙
3. 载流子与输运：电子和空穴怎么在晶体里跑起来

一句话线索：孤立原子有分立的能级 → 大量原子聚成晶体，能级分裂成能带 → 能带填满与否决定了导电性。

原理

一、晶体结构

晶体是原子在三维空间周期性重复排列的固体。描述它只需两个要素：

• 晶格（空间点阵）：周期性重复的几何骨架
• 基元：挂在每个格点上的原子（或原子团）

$$\text{晶体结构}=\text{晶格}+\text{基元}$$

典型结构	代表	配位数	特点
简单立方	钋	6	最稀疏
体心立方 BCC	铁（常温）、钨	8	—
面心立方 FCC	铜、铝、金	12	最密堆积之一，延展性好
金刚石结构	硅、锗、金刚石	4	每个原子与 4 个邻居成共价键，两套 FCC 套合

硅是金刚石结构，每个 Si 原子（4 价）与周围 4 个 Si 原子共用电子对，形成正四面体——这个结构决定了硅的一切电学性质。

真实晶体总有缺陷：点缺陷（空位、间隙原子、杂质）、线缺陷（位错）、面缺陷（晶界）。缺陷不是坏事——半导体的全部魔法都来自"有意掺入的杂质缺陷"。

二、能带论（核心）

单个原子的电子能级是分立的。当 N 个原子靠近成晶体时，泡利不相容原理迫使原来相同的能级分裂成 N 条靠得极近的能级，密到几乎连成一片——这就是能带。

$$\text{原子能级}\stackrel{\text{原子靠近}}{\to }\text{能带}$$

关键的三条带：

能带	含义
价带	被价电子（成键电子）占据的最高能带
导带	价带之上的空能带（或半满带），电子可在其中自由移动导电
禁带（带隙 $E_g$）	价带顶与导带底之间的能量区间，电子不能待在这里

导电性判据（整个固体物理最实用的一条结论）：

材料	能带情形	带隙	例子
导体	价带未满，或价带与导带重叠	无	铜、铝、银
半导体	价带满、导带空，但带隙窄	0.1–3 eV（Si 1.12 eV，Ge 0.67 eV）	硅、锗、砷化镓
绝缘体	价带满、导带空，带隙宽	> 5 eV（金刚石 5.5 eV，SiO₂ 约 9 eV）	玻璃、橡胶、陶瓷

温度升高时，热运动把更多电子从价带激发到导带——所以半导体导电性随温度升高而增强（与金属相反，金属升温电阻变大）。

三、载流子：电子与空穴

电子受激发跳到导带后，在价带留下一个空位，称为空穴。空穴带正电，是大量价电子集体行为的等效描述（不是真实粒子，但当作粒子处理完全正确且极其方便）。

• 本征半导体：纯净晶体，电子浓度 = 空穴浓度 = $n_i$。硅在 300 K 时 $n_i\approx 1.0\times {10}^{10}{\text{cm}}^{-3}$
• N 型：掺入 5 价杂质（磷、砷），多出一个自由电子 → 多数载流子是电子
• P 型：掺入 3 价杂质（硼），缺一个电子 → 多数载流子是空穴

掺杂浓度只要百万分之一量级，导电能力就能提升上百万倍——这是半导体器件可控性的根源。

四、输运：漂移、迁移率与电导率

$$\sigma =nq{\mu }_n+pq{\mu }_p,\rho =\frac{1}{\sigma }$$

其中 $n,p$ 是电子与空穴浓度（cm${}^{-3}$），$\mu$ 是迁移率（cm²/V·s，反映载流子跑得快不快），$q=1.6\times {10}^{-19}\text{C}$。硅中 ${\mu }_n\approx 1350$、${\mu }_p\approx 480$ cm²/V·s——电子比空穴跑得快约 3 倍，这也是 CMOS 里 NMOS 通常做得比 PMOS 小的原因之一。

霍尔效应：磁场让运动的载流子偏转，在样品两侧积累电荷形成横向电压 $U_H=R_H{\displaystyle \frac{IB}{d}}$。测霍尔电压可判定载流子类型（N 型还是 P 型）与浓度，是半导体表征的常规手段。

示例

例 1：掺杂硅的电导率与电阻率

一片硅掺磷，施主浓度 $N_D=1.0\times {10}^{16}{\text{cm}}^{-3}$，室温下杂质几乎全部电离，取 ${\mu }_n=1350{\text{cm}}^2/\text{V·s}$。

多数载流子浓度（室温下 $N_D\gg n_i$，空穴可忽略）：

$$n\approx N_D=1.0\times {10}^{16}{\text{cm}}^{-3},p=\frac{n_i^2}{n}=\frac{(1.0\times {10}^{10}{)}^2}{1.0\times {10}^{16}}=1.0\times {10}^4{\text{cm}}^{-3}$$

电导率：

$$\sigma =nq{\mu }_n=1.0\times {10}^{16}\times 1.6\times {10}^{-19}\times 1350\approx 2.16(\mathrm{\Omega }\cdot \text{cm}{)}^{-1}$$

电阻率：$\rho =1/\sigma \approx 0.46\mathrm{\Omega }\cdot \text{cm}$

对比本征硅：${\sigma }_i=n_{i}q({\mu }_n+{\mu }_p)=1.0\times {10}^{10}\times 1.6\times {10}^{-19}\times 1830\approx 2.9\times {10}^{-6}$，电阻率约 $3.4\times {10}^5\mathrm{\Omega }\cdot \text{cm}$。掺杂把电阻率降低了约 6 个数量级。

例 2：判断材料的导电类型

带隙数据：硅 $E_g=1.12\text{eV}$，砷化镓 $E_g=1.43\text{eV}$，二氧化硅 $E_g\approx 9\text{eV}$，铜（无带隙）。

• 铜：价带与导带重叠 → 导体
• 硅、砷化镓：带隙 1–1.5 eV，室温热能 $kT\approx 0.026\text{eV}$ 虽远小于带隙，但足以激发少量载流子 → 半导体
• 二氧化硅：带隙 9 eV，室温下几乎无电子能跨越 → 绝缘体（这正是它在芯片里当绝缘层、栅介质的原因）

为什么带隙要"不大不小"：太大 → 载流子太少、不导电；太小 → 室温下就大量激发、器件关不断（无法做开关）。硅的 1.12 eV 恰好落在能做出稳定开关的区间，这是硅能统治半导体工业的物理原因之一（锗 0.67 eV 偏小，高温漏电严重）。

用代码验算

q = 1.6e-19
ni, mu_n, mu_p = 1.0e10, 1350.0, 480.0

# 例 1：N 型硅
ND = 1.0e16
n, p = ND, ni**2 / ND
sigma = n * q * mu_n + p * q * mu_p
print(f"n={n:.1e} cm^-3  p={p:.1e} cm^-3")
print(f"σ = {sigma:.2f} (Ω·cm)^-1   ρ = {1/sigma:.2f} Ω·cm")

# 本征硅对比
sigma_i = ni * q * (mu_n + mu_p)
print(f"本征硅 σ = {sigma_i:.2e}  ρ = {1/sigma_i:.2e} Ω·cm  相差 {1/sigma_i/(1/sigma):.0e} 倍")

# 例 2：带隙对应的激发概率（玻尔兹曼因子 exp(-Eg/2kT)）
import math
kT = 0.0259  # 300 K，单位 eV
for name, Eg in (("Si", 1.12), ("GaAs", 1.43), ("SiO2", 9.0)):
    print(f"{name}: Eg={Eg} eV  exp(-Eg/2kT) = {math.exp(-Eg/(2*kT)):.2e}")

要点

要点与常见误区

1. 能带来自能级分裂：孤立原子的分立能级 → N 个原子靠近 → 因泡利不相容原理分裂成 N 条近邻能级 → 连成能带。
2. 导电与否不看"有没有电子"，看"有没有空位可动"。 满带不导电（电子无处可去），未填满的带或空带才导电。
3. 禁带是电子不能存在的区域，不是"电子跑得很慢的地方"。
4. 空穴是等效概念，不是真实粒子，但按带正电的粒子处理完全正确；它的迁移率比电子低。
5. 半导体电阻随温度升高而下降（载流子变多），金属相反（晶格振动加剧、散射变强）。这是区分二者的实用判据。
6. 掺杂不改变整体电中性：施主失去电子后成为固定的正离子，电子总数守恒，只是多了可自由移动的载流子。
7. 掺杂浓度 ≫ 本征载流子浓度时，多数载流子浓度约等于掺杂浓度，少数载流子由 $np=n_i^2$ 决定（质量作用定律）。
8. 摩尔定律的物理极限在这里：栅氧化层薄到几个纳米后，电子会量子隧穿直接穿过去，漏电急剧上升——这是固体物理给出的硬边界。

小结

• 晶体 = 晶格 + 基元；硅是金刚石结构，四价共价键。
• 能带论给出导电性判据：看价带是否填满、带隙有多宽——导体 / 半导体 / 绝缘体由此三分。
• 掺杂制造 N 型（多电子）与 P 型（多空穴），电导率 $\sigma =nq{\mu }_n+pq{\mu }_p$ 是器件设计的起点。
• 下一步：把 N 型和 P 型贴在一起就是 PN 结，二极管、晶体管由此而来，详见 硅 · 半导体与器件。

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